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实现数据位宽转换电路，实现24bit 数据输入转换为128bit 数据输出。其中，先到的数据应置于输出的高bit 位。 电路的接口如下图所示。valid_in 用来指示数据输入data_in 的有效性，valid_out 用来指示数据输出data_out 的有效性；clk 是时钟信号；rst_n 是异步复位信号。 接口时序示意图 请使用以下代码模板完成本题： `timescale 1ns/1ns module width_24to128( input  clk  ,    input  rst_n , input valid_in , input [23:0] data_in ,     output reg valid_out , output  reg [127:0] data_out ); endmodule
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