数字IC关注什么工艺角
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数字IC关注什么工艺角
一般前端综合的网表交到后端以后，后端会考虑很多东西比如delay等，会返回来三个文件，就是解题思路说的ss,tt,ff。在将这三种导进前端设计中，在vcs+verdi流程走一遍，进行仿真，一般来说，跑个ss就可以知道设计有没有问题。看有没有导进去的方法就是比如看clk和data的数据有无falling edge 或者rising edge处的delay。其实这就是网上说的考虑wire延时，只不过一般设计中由后端来考虑这些事情
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